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基于存算结合的多通道卷积FPGA架构及其工作方法

发明专利有效专利
  • 申请号:
    CN202110944948.2
  • IPC分类号:G06N3/063;G06N3/08;G06N3/04;G06T1/20;G06K9/46
  • 申请日期:
    2021-08-17
  • 申请人:
    北京理工大学;北京理工大学重庆创新中心
著录项信息
专利名称基于存算结合的多通道卷积FPGA架构及其工作方法
申请号CN202110944948.2申请日期2021-08-17
法律状态公开申报国家中国
公开/公告日2021-11-19公开/公告号CN113673691A
优先权暂无优先权号暂无
主分类号G06N3/063IPC分类号G;0;6;N;3;/;0;6;3;;;G;0;6;N;3;/;0;8;;;G;0;6;N;3;/;0;4;;;G;0;6;T;1;/;2;0;;;G;0;6;K;9;/;4;6查看分类表>
申请人北京理工大学;北京理工大学重庆创新中心申请人地址
北京市海淀区中关村南大街5号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人北京理工大学,北京理工大学重庆创新中心当前权利人北京理工大学,北京理工大学重庆创新中心
发明人师皓;徐明;陈亮;张娜
代理机构重庆智慧之源知识产权代理事务所(普通合伙)代理人余洪;高彬
摘要
本发明提供一种基于存算结合的多通道卷积FPGA架构及其工作方法,包括:外部存储器、特征图片上缓存模块、卷积权重片上缓存模块和卷积计算模块;外部存储器包括有第一外部存储器和第二外部存储器,第一外部存储器向特征图片上缓存模块输出特征图数据,第二外部存储器向卷积权重片上缓存模块输出卷积权重;特征图片上缓存模块和卷积权重片上缓存模块均与卷积计算模块连接,分别向卷积计算模块输出多个特征图数据窗口和多个卷积权重窗口;卷积计算模块根据特征图数据窗口和卷积权重窗口进行计算,并输出计算结果。本发明通过多通道并行输出数据流的方式,实现存算结合,提高了FPGA架构的数据传输效率。

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