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半导体器件及其形成方法

发明专利有效专利
  • 申请号:
    CN202011191758.X
  • IPC分类号:H01L21/28;H01L21/3215;H01L21/336;H01L29/49;H01L29/78
  • 申请日期:
    2020-10-30
  • 申请人:
    上海华力微电子有限公司
著录项信息
专利名称半导体器件及其形成方法
申请号CN202011191758.X申请日期2020-10-30
法律状态实质审查申报国家暂无
公开/公告日2020-12-29公开/公告号CN112151367A
优先权暂无优先权号暂无
主分类号H01L21/28IPC分类号H;0;1;L;2;1;/;2;8;;;H;0;1;L;2;1;/;3;2;1;5;;;H;0;1;L;2;1;/;3;3;6;;;H;0;1;L;2;9;/;4;9;;;H;0;1;L;2;9;/;7;8查看分类表>
申请人上海华力微电子有限公司申请人地址
上海市浦东新区良腾路6号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人上海华力微电子有限公司当前权利人上海华力微电子有限公司
发明人李高原;顾林;何亮亮
代理机构上海思微知识产权代理事务所(普通合伙)代理人曹廷廷
摘要
本发明提供了一种半导体器件及其形成方法。在本发明提供了一种新的半导体器件的形成方法中,通过将现有技术中的形成高K金属栅CMOS器件中的单晶硅栅极层替换为非晶硅栅极层,并通过对非晶硅栅极层进行退火处理,从而使非晶硅栅极中的非晶硅再结晶形成多晶硅栅极。由于CMOS器件中栅极堆叠层的有效电阻与晶硅栅中的掺杂离子浓度的均匀性,以及掺杂离子的渗透程度有关,因此,可以通过将非晶硅进行退火处理,从而得到对掺杂离子具有高渗透力的多晶硅,在该多晶硅中掺杂P型或N型离子后能够获得相对更加均匀的掺杂浓度,由此提高最终的CMOS器件中栅极结构的多晶硅栅极层中的掺杂离子浓度的均匀度,以及掺杂离子的渗透程度,进而减小栅极电阻。

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