一种基于FPGA的频综接收机快速跳频电路

实用新型专利有效专利

申请号：
CN201920247721.0
IPC分类号：H04B1/16;H04B1/713;H04B1/00
申请日期：
2019-02-27
申请人：
武汉博畅通信设备有限责任公司

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著录项信息

专利名称	一种基于FPGA的频综接收机快速跳频电路
申请号	CN201920247721.0	申请日期	2019-02-27
法律状态	授权	申报国家	中国
公开/公告日		公开/公告号
优先权	暂无	优先权号	暂无
主分类号	H04B1/16 ? IPC结构图谱： H 电学 H9 电学 H04 电通信技术 H04B 传输〔4〕 H04B1/00 不包含在H04B 3/00至H04B 13/00单个组中的传输系统的部件；不以所使用的传输媒介为特征区分的传输系统的部件〔4〕 H04B1/06 接收机 H04B1/16 电路	IPC分类号	H;0;4;B;1;/;1;6;;;H;0;4;B;1;/;7;1;3;;;H;0;4;B;1;/;0;0查看分类表>
申请人	武汉博畅通信设备有限责任公司	申请人地址	湖北省武汉市江岸区大智路125号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	武汉博畅通信设备有限责任公司	当前权利人	武汉博畅通信设备有限责任公司
发明人	付泉斌;蔡楚才
代理机构	武汉红观专利代理事务所（普通合伙）	代理人	李季

摘要

本实用新型提出了一种基于FPGA的频综接收机快速跳频电路，通过设置第一锁相环和第二锁相环组成并行双锁相环，在FPGA在捕捉到跳频控制字后，开启第一锁相环和第二锁相环，射频开关选通第一锁相环，第一锁相环进入频率f1锁定等待状态，第二锁相环进入频率f2的预锁定状态，第一锁相环的频率f1锁定后，射频开关选通第二锁相环，第一锁相环进入频率f3的预锁定状态，第二锁相环进入频率f2的锁定等待状态，如此循环，实现并行双锁相环的快速锁定；使用锁相环锁定自校准功能，锁相环的锁定时间达到36us以内；通过设置射频开关，可以突破频综接收机跳频时间受到锁相环芯片稳定时间的限制，实现锁相环的锁定时间达到18us以内。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
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