VCO和PLL电路,信息记录装置和同步时钟信号产生方法

发明专利无效专利

申请号：
CN200610108669.8
IPC分类号：H03L7/08;H03L7/099;G11B20/10
申请日期：
2004-12-27
申请人：
恩益禧电子股份有限公司;日本电气株式会社

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法律信息

引证文献

著录项信息

专利名称	VCO和PLL电路,信息记录装置和同步时钟信号产生方法
申请号	CN200610108669.8	申请日期	2004-12-27
法律状态	撤回	申报国家	中国
公开/公告日	2007-02-14	公开/公告号	CN1913358
优先权	暂无	优先权号	暂无
主分类号	H03L7/08 ? IPC结构图谱： H 电学 H9 电学 H03 基本电子电路 H03L 电子振荡器或脉冲发生器的自动控制、起振、同步或稳定（发电机的入H02P）〔3〕 H03L7/00 频率或相位的自动控制；同步（一般谐振电路的调谐入H03J；数字通信系统中的同步见H04类中的有关各组）〔3〕 H03L7/06 应用加到频率或相位锁定环上的基准信号的〔3〕 H03L7/08 锁相环的零部件〔3〕	IPC分类号	H;0;3;L;7;/;0;8;;;H;0;3;L;7;/;0;9;9;;;G;1;1;B;2;0;/;1;0查看分类表>
申请人	恩益禧电子股份有限公司;日本电气株式会社	申请人地址	日本神奈川变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	恩益禧电子股份有限公司,日本电气株式会社	当前权利人	恩益禧电子股份有限公司,日本电气株式会社
发明人	佐野正树;萱沼金司
代理机构	中原信达知识产权代理有限责任公司	代理人	孙志湧;陆锦华

摘要

一种PLL电路包括相位比较部分，低通滤波器，数字VCO电路，以及分频器。相位比较部分比较输入的时钟信号的相位和分频的信号的相位以检测相位差。所述低通滤波器平均相位比较部分输出的相位差以输出平均的结果来作为频率控制输入。所述数字VCO电路与参考时钟信号同步操作，基于所述频率控制输入而产生同步时钟信号，同时以预定分辨率值为单位控制所述同步时钟信号的相位，所述预定分辨率值是所述参考时钟信号的周期的1/k，k是大于1的自然数。所述分频器分频所述同步时钟信号以产生分频时钟信号。

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