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三维电路的制造方法

发明专利无效专利
  • 申请号:
    CN201110202041.5
  • IPC分类号:H05K3/00;H05K3/06;H05K3/38;H01Q1/38;H01L33/00
  • 申请日期:
    2011-07-19
  • 申请人:
    联滔电子有限公司;胡泉凌
著录项信息
专利名称三维电路的制造方法
申请号CN201110202041.5申请日期2011-07-19
法律状态权利终止申报国家中国
公开/公告日2013-01-23公开/公告号CN102892252A
优先权暂无优先权号暂无
主分类号H05K3/00IPC分类号H;0;5;K;3;/;0;0;;;H;0;5;K;3;/;0;6;;;H;0;5;K;3;/;3;8;;;H;0;1;Q;1;/;3;8;;;H;0;1;L;3;3;/;0;0查看分类表>
申请人联滔电子有限公司;胡泉凌申请人地址
江苏省苏州市昆山市锦溪镇锦昌路158号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人胡泉凌,昆山联滔电子有限公司当前权利人胡泉凌,昆山联滔电子有限公司
发明人胡泉凌;陈誉尉
代理机构北京高默克知识产权代理有限公司代理人王业晖
摘要
本发明涉及一种三维电路的制造方法,包含有:提供一三维立体结构的本体;对本体进行表面脱脂及粗化处理;对本体表面进行金属化处理,沉积形成金属薄膜层;对金属薄膜层表面进行光阻涂布处理,形成光阻保护层;对光阻保护层进行曝光/显影处理,形成图案化光阻保护层;对显露的金属薄膜层进行蚀刻处理,形成图案化线路层;剥除图案化线路层上的光阻保护层;对图案化线路层表面进行化学镀层处理,形成线路增厚层。如此即可在三维立体结构的本体上直接形成一立体布线的电路图案,而无须在本体上额外设置一电路载体,以满足轻、薄、短、小的需求。

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