在分体模块间进行AXI总线信号发送接收的方法及装置

发明专利有效专利

申请号：
CN201110302764.2
IPC分类号：G06F13/42
申请日期：
2011-10-09
申请人：
中兴通讯股份有限公司

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专利名称	在分体模块间进行AXI总线信号发送接收的方法及装置
申请号	CN201110302764.2	申请日期	2011-10-09
法律状态	暂无	申报国家	中国
公开/公告日	2013-04-10	公开/公告号	CN103034610A
优先权	暂无	优先权号	暂无
主分类号	G06F13/42 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F13/00 信息或其他信号在存储器、输入/输出设备或者中央处理机之间的互连或传送（专用于输入/输出设备的接口电路入G06F 3/00；多处理机系统入G06F 15/16）〔4〕 G06F13/38 信息传送，例如，在总线上进行的（G06F 13/14优先）〔4〕 G06F13/42 总线传送协议，例如，信号的交接过程；同步〔4〕	IPC分类号	G;0;6;F;1;3;/;4;2查看分类表>
申请人	中兴通讯股份有限公司	申请人地址	广东省深圳市南山区高新技术产业园科技南路中兴通讯大厦变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	中兴通讯股份有限公司	当前权利人	中兴通讯股份有限公司
发明人	李虎虎;杜睿;王峰;唐雄;万振华
代理机构	北京安信方达知识产权代理有限公司	代理人	解婷婷;龙洪

摘要

一种在分体模块间进行AXI总线信号传输的方法及装置，所述发送方法包括：发送方模块通过AXI总线将待发送数据写入兵乓随机存取存储器(RAM)中；其中，写入速率为clk0，通过AXI总线写入的数据位宽为N；帧格式转换单元从乒乓RAM中读取数据，并将在预设时长内读出的数据及同步字K28.5写入到一宽为M比特的帧格式后，发送给第一串行器/解串器(SERDES)；其中，M为第一SERDES的并行输入数据位宽值；第一SERDES对该帧格式中的所有比特数据进行编码、并串转换及数模转换处理后，以串行的方式发送给接收方模块。本发明解决了分体模块之间进行数据传输时AXI总线的成本高、延迟大、性能低的问题。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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