一种模拟忆阻器的电路

发明专利无效专利

申请号：
CN201210100158.7
IPC分类号：G11C16/34
申请日期：
2012-04-09
申请人：
武汉科技大学

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法律信息

引证文献

著录项信息

专利名称	一种模拟忆阻器的电路
申请号	CN201210100158.7	申请日期	2012-04-09
法律状态	权利终止	申报国家	中国
公开/公告日	2012-08-01	公开/公告号	CN102623062A
优先权	暂无	优先权号	暂无
主分类号	G11C16/34 ? IPC结构图谱： G 物理 G9 G部其他 G11 信息存储 G11C 静态存储器（基于记录载体和换能器之间的相对运动而实现的信息存储入G11B；半导体存储器件入H01L，例如一般脉冲技术入H03K，例如，电子开关入H03K17/00） G11C16/00 可擦除可编程序只读存储器（G11C 14/00优先）〔5〕 G11C16/02 电可编程序的〔5〕 G11C16/06 辅助电路，例如，用于写入存储器的（一般入G11C 7/00）〔5〕 G11C16/34 编程状态的确定，例如，阈值电压、过编程或欠编程、保留〔7〕	IPC分类号	G;1;1;C;1;6;/;3;4查看分类表>
申请人	武汉科技大学	申请人地址	湖北省武汉市青山区建设一路变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	武汉科技大学	当前权利人	武汉科技大学
发明人	蒋旻;段宗胜;陈波;甘朝晖
代理机构	武汉科皓知识产权代理事务所（特殊普通合伙）	代理人	张火春

摘要

本发明涉及一种忆阻器仿真模型。其技术方案是：该模型由比较器(1)、乘法器(2)、积分器(3)、忆阻器等效电阻(4)和窗函数(5)组成。比较器(1)的输入端C1和C2与忆阻器等效电阻(4)的端子A和B对应连接，比较器(1)的输出端Co与乘法器(2)的输入端M1连接；乘法器(2)的输入端M2与忆阻器等效电阻(4)的端子B连接，乘法器(2)的输入端M3与窗函数(5)的输出端Fo连接，乘法器(2)的输出端Mo与积分器(3)的输入端Ii连接；积分器(3)的输出端分别与忆阻器等效电阻(4)的输入端W和窗函数(5)的输入端Fi连接。本发明能很好地模拟忆阻器的“激活”特性，阻值也呈非线性连续变化，其电气特性与HP实验室发现的忆阻器物理模型的电气特性相符。

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