一种延迟锁定回路

发明专利有效专利

申请号：
CN202111082024.2
IPC分类号：H03L7/08;H03K5/00
申请日期：
2021-09-15
申请人：
浙江力积电子有限公司

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法律信息

引证文献

著录项信息

专利名称	一种延迟锁定回路
申请号	CN202111082024.2	申请日期	2021-09-15
法律状态	公开	申报国家	中国
公开/公告日	2021-10-22	公开/公告号	CN113541679A
优先权	暂无	优先权号	暂无
主分类号	H03L7/08 ? IPC结构图谱： H 电学 H9 电学 H03 基本电子电路 H03L 电子振荡器或脉冲发生器的自动控制、起振、同步或稳定（发电机的入H02P）〔3〕 H03L7/00 频率或相位的自动控制；同步（一般谐振电路的调谐入H03J；数字通信系统中的同步见H04类中的有关各组）〔3〕 H03L7/06 应用加到频率或相位锁定环上的基准信号的〔3〕 H03L7/08 锁相环的零部件〔3〕	IPC分类号	H;0;3;L;7;/;0;8;;;H;0;3;K;5;/;0;0查看分类表>
申请人	浙江力积电子有限公司	申请人地址	浙江省金华市金东区孝顺镇正涵南街1088号13楼1302室变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	浙江力积电子有限公司	当前权利人	浙江力积电子有限公司
发明人	亚历山大;上官朦朦
代理机构	江苏坤象律师事务所	代理人	赵新民;夏纯

摘要

本发明提供一种延迟锁定回路包括：可变延迟块，用于接收从外部输入的输入时钟，以产生中间时钟；固定延迟块，耦接至可变延迟块之后产生内部反馈时钟；鉴相器，检测内部反馈时钟与输入时钟的相位差，输出比较结果；控制器，基于比较结果改变可变延迟块的延迟量，产生与输入时钟同相位的输出时钟。可变延迟块包括主延迟链以及至少一条附加延迟链，用于响应于控制信号开启其中一条；主延迟链和附加延迟链结构相同。使用至少两条延迟链来进行锁定延迟，在正常情况下使用主延迟链，当主延迟链发生溢出时，启动附加延迟链来替换主延迟链，相较于重启DLL电路，切换耗费时间短，时钟跳变小，能够尽快恢复DLL电路的正常工作，减少数据传输的丢失。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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