并行-串行转换电路及使用了它的电子设备

发明专利有效专利

申请号：
CN200680001704.4
IPC分类号：H03M9/00
申请日期：
2006-09-14
申请人：
罗姆股份有限公司

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著录项信息

专利名称	并行-串行转换电路及使用了它的电子设备
申请号	CN200680001704.4	申请日期	2006-09-14
法律状态	授权	申报国家	中国
公开/公告日	2008-01-02	公开/公告号	CN101099293
优先权	暂无	优先权号	暂无
主分类号	H03M9/00 ? IPC结构图谱： H 电学 H9 电学 H03 基本电子电路 H03M 一般编码、译码或代码转换（用射流方法入F15C 4/00；光学模/数转换器入G02F 7/00；专用于特殊应用的编码、译码或代码转换见有关小类，例如G01D，G01R，G06F，G06T，G09G，G10L，G11B，G11C，H04B，H04L，H04M，H04N；专用于密码技术或涉及需要保密的其他目的的编码或译码入G09C）〔4〕 H03M9/00 并行/串行转换或相反转换（其中的信息逐级移动的数字存储器本身入G11C 19/00）〔4〕	IPC分类号	H;0;3;M;9;/;0;0查看分类表>
申请人	罗姆股份有限公司	申请人地址	日本京都府变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	罗姆股份有限公司	当前权利人	罗姆股份有限公司
发明人	斋藤晋一
代理机构	北京市柳沈律师事务所	代理人	邸万奎;蒲迈文

摘要

本发明提供一种能灵活地设定时钟频率和数据宽度的并行-串行转换电路。并行-串行转换电路(100)将时钟频率为f、m×n(m、n为自然数)位的并行数据转换成时钟频率为f×m×n、1位的串行数据。第1转换部(10)将m×n位的并行数据转换成时钟频率为f×n、m位的并行数据(Dp)。第2转换部(12)将从第1转换部(10)输出的时钟频率为f×n、m位的并行数据(Dp)转换成时钟频率为f×n×m、1位的串行数据(Dout)。时钟信号生成电路(20)对第1转换部(10)提供频率为f×n的时钟信号(CK1)，对第2转换部(12)提供频率为f×n×m的时钟信号(CK2)。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
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