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一种芯片上电过程信号计数延迟的方法和电路

发明专利有效专利
  • 申请号:
    CN200910243494.5
  • IPC分类号:G06F1/24;H03K5/13
  • 申请日期:
    2009-12-23
  • 申请人:
    北京中电华大电子设计有限责任公司
著录项信息
专利名称一种芯片上电过程信号计数延迟的方法和电路
申请号CN200910243494.5申请日期2009-12-23
法律状态暂无申报国家中国
公开/公告日2011-06-29公开/公告号CN102111127A
优先权暂无优先权号暂无
主分类号G06F1/24IPC分类号G;0;6;F;1;/;2;4;;;H;0;3;K;5;/;1;3查看分类表>
申请人北京中电华大电子设计有限责任公司申请人地址
北京市昌平区北七家未来科技城南区中国电子网络安全和信息化产业基地C栋 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人北京中电华大电子设计有限责任公司当前权利人北京中电华大电子设计有限责任公司
发明人卢锋;赵贵勇;关红波;刘华茂
代理机构暂无代理人暂无
摘要
本发明涉及芯片的可靠性领域,是一种芯片上电过程信号计数延迟的方法。该方法通过改进传统的芯片上电时延迟计数电路,增强了电路计数延迟时间的可靠性。本发明的具体实施是在芯片上电过程中对一些信号利用计数器进行延迟时,在延迟计数器的计数数值中,抽取一些计数的标记,只有当这些抽取的标记数值都被计数器计过之后,计数器才停止计数,计数器停止后产生延迟之后的信号。采用本发明的方法可以增强芯片在非正常上电时延迟计数器的计数数值的保证,能显著提高芯片非正常上电时的可靠性。

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