一种集成于FPGA的动态多启动电路与FPGA

发明专利有效专利

申请号：
CN202110267498.8
IPC分类号：G11C16/08;G06F12/06;G11C8/10
申请日期：
2021-03-11
申请人：
厦门智多晶科技有限公司

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著录项信息

专利名称	一种集成于FPGA的动态多启动电路与FPGA
申请号	CN202110267498.8	申请日期	2021-03-11
法律状态	实质审查	申报国家	中国
公开/公告日	2021-06-25	公开/公告号	CN113035253A
优先权	暂无	优先权号	暂无
主分类号	G11C16/08 ? IPC结构图谱： G 物理 G9 G部其他 G11 信息存储 G11C 静态存储器（基于记录载体和换能器之间的相对运动而实现的信息存储入G11B；半导体存储器件入H01L，例如一般脉冲技术入H03K，例如，电子开关入H03K17/00） G11C16/00 可擦除可编程序只读存储器（G11C 14/00优先）〔5〕 G11C16/02 电可编程序的〔5〕 G11C16/06 辅助电路，例如，用于写入存储器的（一般入G11C 7/00）〔5〕 G11C16/08 地址电路；译码器；字线控制电路〔7〕	IPC分类号	G;1;1;C;1;6;/;0;8;;;G;0;6;F;1;2;/;0;6;;;G;1;1;C;8;/;1;0查看分类表>
申请人	厦门智多晶科技有限公司	申请人地址	福建省厦门市火炬高新区火炬园火炬路56-58号火炬广场南楼304-20号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	厦门智多晶科技有限公司	当前权利人	厦门智多晶科技有限公司
发明人	蔡旭伟;张亭亭;古生霖;王兴兴;贾红;陈维新;韦嶔;程显志
代理机构	西安嘉思特知识产权代理事务所（普通合伙）	代理人	刘长春

摘要

本发明涉及一种集成于FPGA的动态多启动电路与FPGA，该电路包括：接收模块、重配置触发模块、地址选择模块以及重配置模块，其中，接收模块，用于接收编码数据；重配置触发模块，用于对编码数据进行译码，得到译码数据，并判断译码数据是否与预设的重配置特征码匹配，若匹配则触发重配置，并根据匹配的重配置特征码选取对应的重配置模式；地址选择模块，用于读取地址选择控制字，并根据地址选择控制字选择相应模式的启动地址；重配置模块，用于根据选取的重配置模式以及启动地址读取配置数据完成重配置过程。本发明的集成于FPGA的动态多启动电路，通过四组编码启动用户重配置，相比于使用指令集方式更为简便易用。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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该专利没有被任何外部专利所引用！

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