一种抗错误注入攻击的安全芯片加固方法及装置

发明专利有效专利

申请号：
CN201510355203.7
IPC分类号：G06F21/72
申请日期：
2015-06-24
申请人：
深圳先进技术研究院

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著录项信息

专利名称	一种抗错误注入攻击的安全芯片加固方法及装置
申请号	CN201510355203.7	申请日期	2015-06-24
法律状态	授权	申报国家	中国
公开/公告日	2015-10-21	公开/公告号	CN104992126A
优先权	暂无	优先权号	暂无
主分类号	G06F21/72 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F21/24 （转入G06F 21/60） G06F21/70 保护特定的内部或外部计算机组件，即保护一个组件从而保护整个计算机〔2013.01〕 G06F21/71 确保安全计算或信息处理〔2013.01〕 G06F21/72 在加密电路中〔2013.01〕	IPC分类号	G;0;6;F;2;1;/;7;2查看分类表>
申请人	深圳先进技术研究院	申请人地址	广东省深圳市南山区西丽大学城学苑大道1068号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	深圳先进技术研究院	当前权利人	深圳先进技术研究院
发明人	邵翠萍;李慧云;徐国卿
代理机构	北京三友知识产权代理有限公司	代理人	王天尧

摘要

本发明提供一种抗错误注入攻击的安全芯片加固方法及装置，包括以下步骤：对安全芯片中的所有逻辑单元分别在错误注入攻击情况下进行加密或解密功能仿真，生成仿真结果；根据所述仿真结果查找故障字典，若在故障字典中查找到与所述仿真结果相同的值，则将相应的被错误注入攻击的逻辑单元标记为敏感单元，直到遍历完所有的逻辑单元为止，生成敏感单元列表；对敏感单元列表中的所有敏感单元进行加固。采用本发明方法及装置可以只对敏感单元进行加固，产生的硬件开销小；不需要设计人员精通密码算法，也不需要了解电路的具体结构，适用于任意的密码电路。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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