多个ROP的并行调度以及ROP的流水设计

发明专利有效专利

申请号：
CN201810852905.X
IPC分类号：G06T1/20
申请日期：
2018-07-30
申请人：
芯视图（常州）微电子有限公司

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法律信息

引证文献

著录项信息

专利名称	多个ROP的并行调度以及ROP的流水设计
申请号	CN201810852905.X	申请日期	2018-07-30
法律状态	暂无	申报国家	暂无
公开/公告日	2019-01-11	公开/公告号	CN109191362A
优先权	暂无	优先权号	暂无
主分类号	G06T1/20 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06T 一般的图像数据处理或产生〔6，2006.01〕 G06T1/00 通用图像数据处理〔6〕 G06T1/20 处理器架构；处理器配置，例如流水线〔6，2006.01〕	IPC分类号	G;0;6;T;1;/;2;0查看分类表>
申请人	芯视图（常州）微电子有限公司	申请人地址	江苏省常州市钟楼区玉龙南路213号G008号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	智绘微电子科技（常州）有限公司	当前权利人	智绘微电子科技（常州）有限公司
发明人	张彦芳
代理机构	暂无	代理人	暂无

摘要

本发明公开了一种多个ROP的并行调度以及ROP的流水设计。ROP包括命令解析、缓冲区清除、片段测试、混合、逻辑操作、屏蔽缓冲区等操作。经ROP处理后的像素、深度、模板等数据写入到指定的帧缓存中，由于需要频繁操作帧缓冲区中的数据，ROP与帧缓冲区之间有对应的Cache；在该设计中采用统一染色器，染色后的顶点数据与像素数据送给ROP，ROP内部进行仲裁，将顶点数据Bypass传给顶点Cache，像素数据送给ROP进行处理。而需要执行的OpenGL命令是由前端命令处理单元FEP下发，GPU图形图像管线中各个模块状态信息也是由FEP统一管理。FEP通过查询状态信息来决定是否给相应的模块下发命令。本发明结构简单，模块划分明确，处理速度快，根据设计要求支持任意多个ROP单元的扩展。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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