小数N分频锁相环的Σ-Δ调制量化误差减小技术

发明专利有效专利

申请号：
CN202011358362.X
IPC分类号：H03M3/00
申请日期：
2020-11-27
申请人：
三星电子株式会社

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专利名称	小数N分频锁相环的Σ-Δ调制量化误差减小技术
申请号	CN202011358362.X	申请日期	2020-11-27
法律状态	公开	申报国家	暂无
公开/公告日	2021-09-03	公开/公告号	CN113346906A
优先权	暂无	优先权号	暂无
主分类号	H03M3/00 ? IPC结构图谱： H 电学 H9 电学 H03 基本电子电路 H03M 一般编码、译码或代码转换（用射流方法入F15C 4/00；光学模/数转换器入G02F 7/00；专用于特殊应用的编码、译码或代码转换见有关小类，例如G01D，G01R，G06F，G06T，G09G，G10L，G11B，G11C，H04B，H04L，H04M，H04N；专用于密码技术或涉及需要保密的其他目的的编码或译码入G09C）〔4〕 H03M3/00 用于检错或纠错的编码、译码或代码转换；编码理论基本假设；编码约束；误差概率估计方法；信道模型；代码的模拟或测试（用于模/数，数/模或代码转换的检错或纠错入H03M1/00至H03M11/00；专用于数字计算机的入G06F11/08；用于基于记录载体和传感器之间相对运动的信息存储器入G11B，例如G11B20/18；用于静态存储器的入G11C）〔4，7，2006.01〕	IPC分类号	H;0;3;M;3;/;0;0查看分类表>
申请人	三星电子株式会社	申请人地址	韩国京畿道变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	三星电子株式会社	当前权利人	三星电子株式会社
发明人	吴王华;姚智伟
代理机构	北京市柳沈律师事务所	代理人	梁栋国

摘要

提供了用于使用锁相环(PLL)的小数N分频频率合成的方法和装置。PLL的相位检测器(PD)确定时钟和反馈时钟(CLKFB)之间的相位差。PLL的低通环路滤波器基于相位差来检测控制电压。PLL的压控振荡器(VCO)基于控制电压来生成周期信号。PLL的Σ‑Δ调制器(SDM)基于频率命令字来生成分频序列比和选择控制信号。多模分频器(MMDIV)基于分频序列比以及周期信号的差分输入来生成第一CLKFB和第二CLKFB。MMDIV基于选择控制信号将第一CLKFB和第二CLKFB中的一个作为CLKFB输出到PD。

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