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电路和扩展频谱时钟生成电路

实用新型专利无效专利
  • 申请号:
    CN201721070065.9
  • IPC分类号:H03K5/1254;H03L7/181
  • 申请日期:
    2017-08-24
  • 申请人:
    意法半导体国际有限公司
著录项信息
专利名称电路和扩展频谱时钟生成电路
申请号CN201721070065.9申请日期2017-08-24
法律状态放弃专利权申报国家中国
公开/公告日公开/公告号
优先权暂无优先权号暂无
主分类号H03K5/1254IPC分类号H;0;3;K;5;/;1;2;5;4;;;H;0;3;L;7;/;1;8;1查看分类表>
申请人意法半导体国际有限公司申请人地址
荷兰阿姆斯特丹 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人意法半导体国际有限公司当前权利人意法半导体国际有限公司
发明人A·库玛;G·米德哈
代理机构北京市金杜律师事务所代理人王茂华;吕世磊
摘要
本公开的实施例涉及电路和扩展频谱时钟生成电路。一种锁相或锁频环电路,包括被配置用于生成其频率由振荡器控制信号设置的输出时钟信号的振荡器。调制器电路接收第一信号和第二信号并且被配置用于生成控制信号,该控制信号的值响应于该第一和第二信号而被调制。滤波器电路通过对该控制信号进行滤波而生成该振荡器控制信号。德尔塔‑西格玛调制器电路操作以响应于调制模式而对该第二信号进行调制。因此,该输出时钟信号为扩展频谱时钟信号。

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