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半导体结构及其形成方法

发明专利有效专利
  • 申请号:
    CN202010327504.X
  • IPC分类号:H01L27/092;H01L21/8238;H01L27/11
  • 申请日期:
    2020-04-23
  • 申请人:
    中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
著录项信息
专利名称半导体结构及其形成方法
申请号CN202010327504.X申请日期2020-04-23
法律状态公开申报国家暂无
公开/公告日2021-10-26公开/公告号CN113555361A
优先权暂无优先权号暂无
主分类号H01L27/092IPC分类号H;0;1;L;2;7;/;0;9;2;;;H;0;1;L;2;1;/;8;2;3;8;;;H;0;1;L;2;7;/;1;1查看分类表>
申请人中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司申请人地址
上海市浦东新区张江路18号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人中芯国际集成电路制造(上海)有限公司,中芯国际集成电路制造(北京)有限公司当前权利人中芯国际集成电路制造(上海)有限公司,中芯国际集成电路制造(北京)有限公司
发明人王楠
代理机构北京集佳知识产权代理有限公司代理人徐文欣
摘要
一种半导体结构及其形成方法,包括:提供基底;在所述基底上形成多个平行排布的上拉鳍部;在所述基底上形成一个或多个辅助鳍部,所述辅助鳍部和所述上拉鳍部的延伸方向相同;在所述上拉鳍部内形成上拉源漏掺杂层;在所述辅助鳍部内形成辅助源漏掺杂层。通过在所述基底上形成一个或多个所述辅助鳍部,以此提升所述基底上的器件密度,在后续形成所述上拉源漏掺杂层时,降低上拉源漏掺杂层的形成空间,使得形成的所述上拉源漏掺杂层的体积减小,进而使得所述上拉源漏掺杂层与其他区域的源漏掺杂层的体积与性能趋于一致,同时也避免相邻的上拉源漏掺杂层形成短接,提升形成的半导体结构的电学性能。

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