一种存储系统和一种ASIC芯片

实用新型专利有效专利

申请号：
CN201920786339.7
IPC分类号：G06F15/78
申请日期：
2019-05-28
申请人：
江苏芯盛智能科技有限公司

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著录项信息

专利名称	一种存储系统和一种ASIC芯片
申请号	CN201920786339.7	申请日期	2019-05-28
法律状态	授权	申报国家	中国
公开/公告日		公开/公告号
优先权	暂无	优先权号	暂无
主分类号	G06F15/78 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F15/00 通用数字计算机（零部件入G06F 1/00至G06F 13/00组）；通用数据处理设备 G06F15/76 计算机程序存储的通用架构（带程序插板的入G06F15/08，多计算机的入G06F15/16）〔5，6，2006.01〕 G06F15/78 包括单个中央处理单元的〔5〕	IPC分类号	G;0;6;F;1;5;/;7;8查看分类表>
申请人	江苏芯盛智能科技有限公司	申请人地址	江苏省常州市武进国家高新技术产业开发区新雅路18号528室变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	江苏芯盛智能科技有限公司	当前权利人	江苏芯盛智能科技有限公司
发明人	张龙
代理机构	北京集佳知识产权代理有限公司	代理人	罗满

摘要

本申请公开了一种存储系统和一种ASIC芯片，该存储系统包括CPU，所述CPU包括CPU内核和信息存储器；所述信息存储器包括用于获取debug数据的输入接口和用于将所述debug数据传输至所述CPU的输出接口。本申请提供的存储系统，CPU内集成有信息存储器，debug数据通过输入接口存储于该信息存储器中。由于信息存储器集成在CPU中，靠近CPU内核，因此访问该信息存储器中的debug数据速度较快。另外访问debug数据时，数据流经过信息存储器的输出接口输出，不需要经过二级缓存对外部的AXI或者AHB接口，当AXI或AHB挂死时，同样可以访问debug数据，稳定性较好。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有被任何外部专利所引用！

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