在基于块的数据流指令集架构(ISA)中配置粗粒度可配置阵列(CGRA)以用于数据流指令块执行

发明专利有效专利

申请号：
CN201680054302.4
IPC分类号：G06F15/78;G06F15/82;G06F9/30
申请日期：
2016-09-02
申请人：
高通股份有限公司

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专利名称	在基于块的数据流指令集架构(ISA)中配置粗粒度可配置阵列(CGRA)以用于数据流指令块执行
申请号	CN201680054302.4	申请日期	2016-09-02
法律状态	实质审查	申报国家	中国
公开/公告日	2018-05-11	公开/公告号	CN108027806A
优先权	暂无	优先权号	暂无
主分类号	G06F15/78 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F15/00 通用数字计算机（零部件入G06F 1/00至G06F 13/00组）；通用数据处理设备 G06F15/76 计算机程序存储的通用架构（带程序插板的入G06F15/08，多计算机的入G06F15/16）〔5，6，2006.01〕 G06F15/78 包括单个中央处理单元的〔5〕	IPC分类号	G;0;6;F;1;5;/;7;8;;;G;0;6;F;1;5;/;8;2;;;G;0;6;F;9;/;3;0查看分类表>
申请人	高通股份有限公司	申请人地址	美国加利福尼亚州变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	高通股份有限公司	当前权利人	高通股份有限公司
发明人	K·桑卡拉林加姆;G·M·赖特
代理机构	北京律盟知识产权代理有限责任公司	代理人	杨林勳

摘要

揭示在基于块的数据流指令集架构ISA中配置粗粒度可配置阵列CGRA以用于数据流指令块执行。在一个方面中，提供CGRA配置电路，其包括具有瓦片阵列的CGRA，所述瓦片中的每一个提供功能单元和开关。所述CGRA配置电路的指令解码电路将数据流指令块内的数据流指令映射到所述CGRA的所述瓦片中的一个。所述指令解码电路解码所述数据流指令，并且产生所述经映射瓦片的所述功能单元的功能控制配置，以提供所述数据流指令的功能性。所述指令解码电路另外产生沿着所述CGRA内的瓦片路径的开关的开关控制配置，使得所述经映射瓦片的所述功能单元的输出路由到对应于所述数据流指令的消费者指令的每一瓦片。

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