一种视频拼接器

实用新型专利无效专利

申请号：
CN200920222349.4
IPC分类号：H04N7/24
申请日期：
2009-09-03
申请人：
中国电子科技集团公司第四十一研究所

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法律信息

引证文献

著录项信息

专利名称	一种视频拼接器
申请号	CN200920222349.4	申请日期	2009-09-03
法律状态	权利终止	申报国家	中国
公开/公告日		公开/公告号
优先权	暂无	优先权号	暂无
主分类号	H04N7/24 ? IPC结构图谱： H 电学 H9 电学 H04 电通信技术 H04N 图像通信，如电视 H04N7/00 电视系统（部件入H04N 3/00，H04N 5/00；用于数字视频信号编码，解码，压缩或解压缩的方法或装置；可选的内容分发入H04N 21/00） H04N7/24 利用脉冲编码调制传输电视信号的系统（H04N 21/00优先）〔6，2011.01〕	IPC分类号	H;0;4;N;7;/;2;4查看分类表>
申请人	中国电子科技集团公司第四十一研究所	申请人地址	安徽省蚌埠市华光大道726号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	中国电子科技集团公司第四十一研究所	当前权利人	中国电子科技集团公司第四十一研究所
发明人	孙守军;倪飞
代理机构	北京君伍时代知识产权代理事务所（普通合伙）	代理人	朱登河

摘要

本实用新型公开一种视频拼接器。所述视频拼接器包括：多组帧缓存FIFO，每组帧缓存FIFO适于与一个提供数字化图像信息及其行场同步控制信号的相应视频信号源相连接以接收数字化图像信息，且每组帧缓存FIFO包括两个帧缓存FIFO，每个帧缓存FIFO包括用于输出经其缓存的数字化图像信息的图像信息输出端口和用于接收控制信号的控制端；以及FPGA数据处理模块，所述FPGA数据处理模块适于与各所述视频信号源相连接而接收所述行场同步控制信号，所述模块进一步与所述各帧缓存FIFO的控制端相连接，其中FPGA数据处理模块设置成：基于行场同步控制信号而控制所述各帧缓存FIFO从相连的相应视频信号源接收数字化图像信息和/或输出其缓存的数字化图像信息。从而，以一种简单的方式实现了视频的拼接。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
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