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具有掺杂的外延区域的半导体器件及其制造方法

发明专利有效专利
  • 申请号:
    CN201510829787.7
  • IPC分类号:H01L29/423;H01L29/66;H01L29/78
  • 申请日期:
    2010-11-29
  • 申请人:
    英特尔公司
著录项信息
专利名称具有掺杂的外延区域的半导体器件及其制造方法
申请号CN201510829787.7申请日期2010-11-29
法律状态授权申报国家中国
公开/公告日2016-04-06公开/公告号CN105470287A
优先权暂无优先权号暂无
主分类号H01L29/423IPC分类号H;0;1;L;2;9;/;4;2;3;;;H;0;1;L;2;9;/;6;6;;;H;0;1;L;2;9;/;7;8查看分类表>
申请人英特尔公司申请人地址
美国加利福尼亚 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人英特尔公司当前权利人英特尔公司
发明人A·S·默西;D·B·奥贝蒂内;T·加尼;A·J·派特
代理机构中国专利代理(香港)有限公司代理人姜冰;杨美灵
摘要
本发明涉及一种具有掺杂的外延区域的半导体器件及其制造方法。本发明的实施例描述了半导体器件上的外延区域。在一个实施例中,通过循环的沉积‑蚀刻工艺来在衬底上沉积所述外延区域。用外延帽层来回填在循环的沉积‑蚀刻工艺期间在间隔体下方产生的空腔。所述外延区域和外延帽层改善了沟道区域的电子迁移率,减小了短沟道效应并降低了寄生电阻。

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