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时钟校准电路和可编程逻辑芯片

发明专利有效专利
  • 申请号:
    CN202110413808.2
  • IPC分类号:H03K5/156;H03K19/173
  • 申请日期:
    2021-04-16
  • 申请人:
    深圳市紫光同创电子有限公司
著录项信息
专利名称时钟校准电路和可编程逻辑芯片
申请号CN202110413808.2申请日期2021-04-16
法律状态实质审查申报国家中国
公开/公告日2021-08-27公开/公告号CN113315493A
优先权暂无优先权号暂无
主分类号H03K5/156IPC分类号H;0;3;K;5;/;1;5;6;;;H;0;3;K;1;9;/;1;7;3查看分类表>
申请人深圳市紫光同创电子有限公司申请人地址
广东省深圳市南山区粤海街道高新区社区高新南一道015号国微研发大楼401 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人深圳市紫光同创电子有限公司当前权利人深圳市紫光同创电子有限公司
发明人林协群;刘可勇;刘磊;冯坚;马硝霞
代理机构深圳市智圈知识产权代理事务所(普通合伙)代理人周献
摘要
本申请提供了一种时钟校准电路和可编程逻辑芯片,涉及集成电路技术领域,改善多个电路单元间信号延时的问题。该电路包括:第一延时电路包括第一延时单元和第一控制电路,第一延时单元在第一控制电路的控制下向鉴相器输入第一输出时钟。第二延时电路包括第二延时单元和第二控制电路,第二延时单元在第二控制电路的控制下向鉴相器输入第二输出时钟。鉴相器计算第一输出时钟和第二输出时钟的相位之差得到比较结果,比较结果大于或等于相位阈值时,将比较结果反馈至第一延时电路和/或第二延时电路,第一控制电路根据比较结果向鉴相器输入新的第一输出时钟和/或第二控制电路根据比较结果向鉴相器输入新的第二输出时钟,直至新的比较结果小于相位阈值。

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