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沟槽栅MOS器件缺陷验证方法

发明专利有效专利
  • 申请号:
    CN201410835941.7
  • IPC分类号:G01R31/26;G01N21/88;G01N1/32;G01N1/44;G01N23/22
  • 申请日期:
    2014-12-24
  • 申请人:
    上海华虹宏力半导体制造有限公司
著录项信息
专利名称沟槽栅MOS器件缺陷验证方法
申请号CN201410835941.7申请日期2014-12-24
法律状态授权申报国家中国
公开/公告日2015-04-01公开/公告号CN104483615A
优先权暂无优先权号暂无
主分类号G01R31/26IPC分类号G;0;1;R;3;1;/;2;6;;;G;0;1;N;2;1;/;8;8;;;G;0;1;N;1;/;3;2;;;G;0;1;N;1;/;4;4;;;G;0;1;N;2;3;/;2;2查看分类表>
申请人上海华虹宏力半导体制造有限公司申请人地址
上海市浦东新区张江高科技园区祖冲之路1399号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人上海华虹宏力半导体制造有限公司当前权利人上海华虹宏力半导体制造有限公司
发明人马香柏
代理机构上海浦一知识产权代理有限公司代理人丁纪铁
摘要
本发明公开了一种沟槽栅MOS器件缺陷验证方法,包含:第一步,对沟槽栅MOS器件样品进行电学测试,扫描栅极对源极的漏电曲线;第二步,根据漏电曲线的特性,初步判定缺陷的大致位置;第三步,采用亮点定位工具,定位失效沟槽在芯片上的位置;第四步,结合第二步的判定结果,选择对应的研磨或聚焦离子束方法进行制样;采用KOH或NaOH溶液溶解残留的栅极多晶硅,找到缺陷位置。

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