一种大规模并行程序性能预测实现方法

发明专利有效专利

申请号：
CN200910092644.7
IPC分类号：G06F11/36;G06F9/38
申请日期：
2009-09-14
申请人：
清华大学

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法律信息

引证文献

著录项信息

专利名称	一种大规模并行程序性能预测实现方法
申请号	CN200910092644.7	申请日期	2009-09-14
法律状态	授权	申报国家	中国
公开/公告日	2010-02-17	公开/公告号	CN101650687
优先权	暂无	优先权号	暂无
主分类号	G06F11/36 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F11/00 错误检测；错误校正；监控（在基于记录载体和传感器之间的相对运动而实现的信息存储中的错误检测、校正或监控所用的方法或装置入 G11B 20/18；监控，即，监控记录或重现的进程入G11B 27/36；静态存储中所用的方法或装置入G11C29/00）〔1，4，2006.01〕 G06F11/36 通过软件的测试或调试防止错误〔7〕	IPC分类号	G;0;6;F;1;1;/;3;6;;;G;0;6;F;9;/;3;8查看分类表>
申请人	清华大学	申请人地址	北京市海淀区清华园北京-82信箱变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	清华大学	当前权利人	清华大学
发明人	郑纬民;陈文光;翟季冬
代理机构	北京路浩知识产权代理有限公司	代理人	胡小永

摘要

本发明公开了一种基于有代表性重放的大规模并行程序性能预测实现方法，该方法属于并行程序性能预测的技术领域，包括步骤：收集并行程序的通信序列和顺序计算向量，分析各个进程计算的相似性并选取有代表性的进程，记录有代表性进程的通信内容，使用目标平台的一个计算节点重放有代表性进程，获取有代表性进程的顺序计算时间，用这些计算时间代替其它进程的计算时间；获取并行程序的通信记录；使用网络模拟器自动预测最终的程序性能。通过本发明能够使用很少的硬件资源，得到精确的并行程序预测性能。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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