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半导体集成电路及其布局方法

发明专利无效专利
  • 申请号:
    CN200780003340.8
  • IPC分类号:H03K19/0175;G06F1/12;H01L21/82;H01L21/822;H01L27/04
  • 申请日期:
    2007-07-25
  • 申请人:
    松下电器产业株式会社
著录项信息
专利名称半导体集成电路及其布局方法
申请号CN200780003340.8申请日期2007-07-25
法律状态放弃专利权申报国家中国
公开/公告日2009-02-25公开/公告号CN101375503
优先权暂无优先权号暂无
主分类号H03K19/0175IPC分类号H;0;3;K;1;9;/;0;1;7;5;;;G;0;6;F;1;/;1;2;;;H;0;1;L;2;1;/;8;2;;;H;0;1;L;2;1;/;8;2;2;;;H;0;1;L;2;7;/;0;4查看分类表>
申请人松下电器产业株式会社申请人地址
日本大阪府 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人松下电器产业株式会社当前权利人松下电器产业株式会社
发明人中村明博
代理机构北京市金杜律师事务所代理人王茂华
摘要
本发明提供一种半导体集成电路及其布局方法。内部电路(151)仅与内部信号收发两用电路(102)之间存在定时限制,与外部信号接收用电路(101)之间不存在定时限制。因此,外部信号接收用电路(101)可实现不受内部电路(151)的定时限制的影响的布局配置。由此,外部信号接收用电路(101)可实现如缩短外部信号接收用电路(101)与外部时钟端子(154)的距离、以及外部信号接收用电路(101)与外部数据端子(155)的距离,使得能够满足存在于外部信号接收用电路(101)与外部时钟端子(154)或外部数据端子(155)之间的定时限制,从而能够容易满足在AC时钟信号与AC数据信号之间产生的定时限制。

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