一种基于双口RAM的CPCI总线与控制电路通信接口

发明专利有效专利

申请号：
CN202110766372.5
IPC分类号：G06F13/40;G06F13/42
申请日期：
2021-07-07
申请人：
北京控制与电子技术研究所

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著录项信息

专利名称	一种基于双口RAM的CPCI总线与控制电路通信接口
申请号	CN202110766372.5	申请日期	2021-07-07
法律状态	公开	申报国家	中国
公开/公告日	2021-11-09	公开/公告号	CN113626362A
优先权	暂无	优先权号	暂无
主分类号	G06F13/40 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F13/00 信息或其他信号在存储器、输入/输出设备或者中央处理机之间的互连或传送（专用于输入/输出设备的接口电路入G06F 3/00；多处理机系统入G06F 15/16）〔4〕 G06F13/38 信息传送，例如，在总线上进行的（G06F 13/14优先）〔4〕 G06F13/40 总线结构〔4〕	IPC分类号	G;0;6;F;1;3;/;4;0;;;G;0;6;F;1;3;/;4;2查看分类表>
申请人	北京控制与电子技术研究所	申请人地址	北京市西城区木樨地北里甲51号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	北京控制与电子技术研究所	当前权利人	北京控制与电子技术研究所
发明人	王一平;陈磊;王晓东;孙明熙;王胜男
代理机构	中国航天科工集团公司专利中心	代理人	张国虹

摘要

本发明公开了一种基于双口RAM的CPCI总线与控制电路通信接口，包括：CPCI总线桥接芯片、上位机处理器、下位机处理器、双口RAM模块、上位机控制模块、下位机应答模块和下位机执行模块；上位机控制模块向双口RAM模块下行命令存储区写入控制命令，然后读取双口RAM模块上行命令应答存储区与上行数据存储区的数据，根据读取的结果继续向双口RAM模块下行命令存储区写入控制命令，依次循环执行；下位机应答模块的工作过程与上位机控制模块相似。上位机控制模块、下位机应答模块与下位机执行模块按照通信规则在双口RAM模块规定存储区进行数据读写通信。本发明避免了读写冲突，减轻通信负担，实现快速实时数据交换。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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