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一种改善集成电路制程中硅位错的方法

发明专利有效专利
  • 申请号:
    CN200710040533.2
  • IPC分类号:H01L21/71;H01L21/283;H01L21/66
  • 申请日期:
    2007-05-11
  • 申请人:
    中芯国际集成电路制造(上海)有限公司
著录项信息
专利名称一种改善集成电路制程中硅位错的方法
申请号CN200710040533.2申请日期2007-05-11
法律状态授权申报国家中国
公开/公告日2008-11-12公开/公告号CN101304000
优先权暂无优先权号暂无
主分类号H01L21/71IPC分类号H;0;1;L;2;1;/;7;1;;;H;0;1;L;2;1;/;2;8;3;;;H;0;1;L;2;1;/;6;6查看分类表>
申请人中芯国际集成电路制造(上海)有限公司申请人地址
上海市浦东新区张江路18号 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人中芯国际集成电路制造(上海)有限公司当前权利人中芯国际集成电路制造(上海)有限公司
发明人杨林宏;陈亮
代理机构上海智信专利代理有限公司代理人王洁
摘要
本发明公开了一种改善集成电路制程中硅位错的方法,包括以下步骤:A)用氧化法生长第一栅氧化层;B)在第一栅氧化层上用化学气相沉积法沉积预定厚度的第二栅氧化层;C)通过电性测量仪器调整第一和第二栅氧化层的厚度,使MOS器件的电性参数符合制程要求。本发明可有效减少硅位错,降低集成电路芯片的泄露电流,从而提高集成电路芯片的良率。

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