一种基于板间互连实现高速总线连通性测试的方法及装置

发明专利有效专利

申请号：
CN201710599986.2
IPC分类号：G06F11/22
申请日期：
2017-07-21
申请人：
中国电子科技集团公司第二十九研究所

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专利名称	一种基于板间互连实现高速总线连通性测试的方法及装置
申请号	CN201710599986.2	申请日期	2017-07-21
法律状态	授权	申报国家	中国
公开/公告日	2017-12-01	公开/公告号	CN107423179A
优先权	暂无	优先权号	暂无
主分类号	G06F11/22 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F11/00 错误检测；错误校正；监控（在基于记录载体和传感器之间的相对运动而实现的信息存储中的错误检测、校正或监控所用的方法或装置入 G11B 20/18；监控，即，监控记录或重现的进程入G11B 27/36；静态存储中所用的方法或装置入G11C29/00）〔1，4，2006.01〕 G06F11/22 在准备运算或者在空闲时间期间内，通过测试作故障硬件的检测或定位〔3，2006.01〕	IPC分类号	G;0;6;F;1;1;/;2;2查看分类表>
申请人	中国电子科技集团公司第二十九研究所	申请人地址	四川省成都市金牛区营康西路496号变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	中国电子科技集团公司第二十九研究所	当前权利人	中国电子科技集团公司第二十九研究所
发明人	罗李焱;张哲
代理机构	成都九鼎天元知识产权代理有限公司	代理人	钱成岑;袁春晓

摘要

本发明公开了一种基于板间互连实现高速总线连通性测试的方法及装置，涉及高速总线测试领域。本发明技术要点：搭建测试硬件通路的步骤：硬件通路包括：上位机、电源、母板、FPGA下载器、两个待测试模块；测试程序加载步骤：上位机通过FPGA下载器分别给两个待测试模块下载不同的测试程序；测试程序的功能是建立待测试模块板内和板间所有高速总线之间的数据传输通道；测试验证步骤：上位机将测试数据及其对应的寄存器地址通过母板的信号连接器发送给第一待测试模块，并接收第一待测试模块返回数据及其地址；比较发送的数据与返回的数据是否一致进而判断总线连接是否异常，通过发送不同的寄存器地址和数据实现对不同总线连通性的测试。

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