一种基于SDIO接口的FPGA板级通信装置及通信方法

发明专利有效专利

申请号：
CN201711006016.3
IPC分类号：G06F13/10;G06F13/40
申请日期：
2017-10-25
申请人：
武汉精测电子集团股份有限公司

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著录项信息

专利名称	一种基于SDIO接口的FPGA板级通信装置及通信方法
申请号	CN201711006016.3	申请日期	2017-10-25
法律状态	授权	申报国家	中国
公开/公告日	2018-02-27	公开/公告号	CN107741915A
优先权	暂无	优先权号	暂无
主分类号	G06F13/10 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F13/00 信息或其他信号在存储器、输入/输出设备或者中央处理机之间的互连或传送（专用于输入/输出设备的接口电路入G06F 3/00；多处理机系统入G06F 15/16）〔4〕 G06F13/10 对外部设备的程序控制（G06F13/14-G06F13/42优先）〔4，2006.01〕	IPC分类号	G;0;6;F;1;3;/;1;0;;;G;0;6;F;1;3;/;4;0查看分类表>
申请人	武汉精测电子集团股份有限公司	申请人地址	湖北省武汉市洪山区南湖大道53号洪山创业中心四楼变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	武汉精测电子集团股份有限公司	当前权利人	武汉精测电子集团股份有限公司
发明人	邓志;许恩;彭骞;陈凯;沈亚非
代理机构	武汉东喻专利代理事务所（普通合伙）	代理人	方可

摘要

本发明公开了一种基于SDIO接口的FPGA板级通信装置及方法，包括通过SDIO总线相连的SDIOMaster模块与SDIOslave模块；SDIOMaster模块包括控制信号处理单元、第一命令控制单元、第一数据处理单元；SDIOslave模块包括第二命令控制单元、第二数据处理单元和数据缓存单元；控制信号处理单元接收上位机或主机FPGA的控制命令并解析；第一、第二数据处理单元根据解析后的控制命令驱动数据在FIFO存储单元和数据缓存单元间进行传输。采用本发明的通信装置，数据在主机和从机FPGA间的传输速度可达到200Mbps，能满足大部分移动设备的高速数据传输需求。

序号	公开(公告)号	公开(公告)日	申请日	专利名称	申请人
该专利没有引用任何外部专利数据！

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