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用于一系列页面的高速缓存刷新和一系列条目的TLB无效的系统、方法和设备

发明专利有效专利

申请号：
CN201010615494.6
IPC分类号：G06F12/08
申请日期：
2010-12-20
申请人：
英特尔公司

基础信息

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法律信息

引证文献

著录项信息

专利名称	用于一系列页面的高速缓存刷新和一系列条目的TLB无效的系统、方法和设备
申请号	CN201010615494.6	申请日期	2010-12-20
法律状态	授权	申报国家	中国
公开/公告日	2011-07-06	公开/公告号	CN102117247A
优先权	暂无	优先权号	暂无
主分类号	G06F12/08 ? IPC结构图谱： G 物理 G0 仪器 G06 计算；推算；计数 G06F 电数字数据处理（基于特定计算模型的计算机系统入G06N） G06F12/00 安装在筛选装置之上的在存储器系统或体系结构内的存取、寻址或分配（来自记录载体的数字输入，或者到记录载体上去的数字输出，例如到磁盘存储单元，G06F 3/06）〔4，5〕 G06F12/02 寻址或地址分配；地址的重新分配（程序地址排序入G06F9/00；在数字存储器中选择地址的设计入G11C8/00）〔4，2006.01〕 G06F12/08 在分级结构的存储系统中的寻址、地址分配、或地址的重新分配，例如，虚拟存储系统〔4，2016.01〕	IPC分类号	G;0;6;F;1;2;/;0;8查看分类表>
申请人	英特尔公司	申请人地址	美国加利福尼亚州变更专利地址、主体等相关变化，请及时变更，防止失效
权利人	英特尔公司	当前权利人	英特尔公司
发明人	M·G·迪克逊;S·D·罗杰斯
代理机构	中国专利代理（香港）有限公司	代理人	俞华梁;王洪斌

摘要

本发明描述用于执行多个高速缓存线的刷新和/或多个转换后备缓冲器(TLB)条目的无效的系统、方法和设备。在一种这样的方法中，为了刷新处理器的多个高速缓存线，单个指令包括指示将要刷新处理器的多个高速缓存线的第一字段，并且响应单个指令，刷新处理器的多个高速缓存线。

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